Vzorové úlohy ve VHDL
Sample assignments in VHDL
Author
Advisor
Holek, RadovanReferee
Macho, TomášGrade
EAltmetrics
Metadata
Show full item recordAbstract
Tato bakalářska prace navazuje na semestralní projekt a zabývá se jazykem VHDL a obvody FPGA a CPLD firmy Xilinx. Dále pak má tato práce za cíl popsat, jak zacházet s vývojovým prostředím WebPack, kde je popsáno jak realizovat nový projekt. Jsou zde popsány různé metody návrhu úlohy v tomto vývojovém prostředí. Nakonec jsou také uvedeny některé vzorové příklady ve VHDL. This bachelor’s study connects on semestral project and is focused on VHDL language and FPGA and CPLD circuits by Xilinx. The aim of this study is to describe how to work with profossional design tool WebPack. Documents detaily describes how to create new project on advanced level - with emphasis on methodiology and examples from practice in VHDL lenguage.
Keywords
jazyk VHDL, WebPack, FPGA, CPLD, Xilinx, VHDl language, WebPack, FPGA, CPLD, XilinxLanguage
čeština (Czech)Study brunch
Automatizační a měřicí technikaComposition of Committee
doc. Ing. Zdeněk Němec, CSc. (předseda) prof. Ing. Petr Vavřín, DrSc. (místopředseda) doc. Ing. Ludvík Bejček, CSc. (člen) Ing. Miloslav Čejka, CSc. (člen) Ing. Pavel Kučera, Ph.D. (člen)Date of defence
2009-06-17Process of defence
Student obhájil bakalářskou práci s výhradami.Result of the defence
práce byla úspěšně obhájenaPersistent identifier
http://hdl.handle.net/11012/3502Source
HUZLÍK, P. Vzorové úlohy ve VHDL [online]. Brno: Vysoké učení technické v Brně. Fakulta elektrotechniky a komunikačních technologií. 2009.Collections
- 2009 [609]